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Informações

FD-SOI FPGAs Get PCIE e LPDDR4 Interfacing

Machxo5t-NX, como são chamados, são adequados para "um conjunto de projetos de funções de controle para redes corporativas, visão de máquina e IoT industrial", afirmou.

Lattice Nexus fpga FD SoI transistorEles são construídos usando o processo FDSOI da empresa (imagem certa), que pode reduzir drasticamente os erros suaves da radiação em comparação com os CMOs a granel, pois há menos volume de semicondutor (laranja) com acesso aos transistores em carregamentos espúrios que podem ser gerados,

Até 7,2Mbit de memória estão incluídos, até 55Mbit de flash do usuário e até 96 mil células lógicas (consulte a tabela abaixo).



Existem até 291 iOS de uso geral "que suportam a configuração precoce de OI e fornecem recursos adicionais, como 1,25Gbit/s sgmii, pull-down padrão, scocket a quente e taxa de slew programável", disse Lattice.

Várias tensões de IO são suportadas (1, 1,2, 1,5, 1,8, 2,5 e 3,3V) e existem interfaces LVDs e MIPI.

Recurso de interface PCIE e LPDDR4 nas duas maiores (53K e 96K Cell) dos três dispositivos anunciados.

Para proteção da propriedade intelectual, há uma caixa múltipla com criptografia de fluxo de bits (AES256) e autenticação (ECC256).

A embalagem é de 17 x 17 mm com afinação de 0,8 mm e há uma opção de 14 x 14 mm para a versão menor (25K).

Machxo5-nx Machxo5t-nx
Dispositivo LFMXO5-25 LFMXO5-55T LFMXO5-100T
Células lógicas 25k 53k 96k
blocos de memória incorporados 80 (x18kbit) 166 208
Memória incorporada 1440kbit 2988 3744
RAM distribuída 184kbit 320 639
Grandes blocos de memória 1 5 7
Grandes bits de memória 512kbit 2560 3584
18 × 18 multiplicadores 20 146 156
Blocos ADC 2 2 2
Oscilador de 450MHz 1 1 1
Oscilador de 128kHz 1 1 1
Pcie gen2 hard ip 0 1 1
Gpll 2 4 4
Flash do usuário (sem inicialização) 15MBIT 79 79

As fontes de treliça variam em alguns dos números usados ​​no artigo e na tabela acima (a verificação de fatos está em andamento); portanto, verifique -os por si mesmo se forem importantes para você.